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If both Master and Target transfers will be used, the connections in both Figure 1-2 and Figure 1-3 should be
implemented.
CorePCIF
BAR_SELECT
RD_CYC
RD_STB_OUT
RD_STB_IN
BUSY
FIFO
READ
EMPTY
DATA_OUT
MEM_DATA_IN
Figure 1-2 · External FIFO Connection (Target mode)
CorePCIF
BAR_SELECT
RD_CYC
RD_STB_OUT
RD_STB_IN
DMA_BAR
RD_BUSY_MASTER
STOP_MASTER
FIFO
READ
EMPTY
ALMOST EMPTY
DATA_OUT
MEM_DATA_IN
Figure 1-3 · External FIFO Connection (Master mode)
22
v4.0
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